| .. |
|
.gitignore
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
Makefile
|
9280b86c0e
phy-fpha: Use PLL
|
5 лет назад |
|
block_ram_mod.v
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
crcgen.py
|
582596891f
crcgen: Move all tests to test module
|
5 лет назад |
|
crcgen_test.py
|
aaeac12a95
crcgen: Run tests in parallel
|
5 лет назад |
|
edge_detect_mod.v
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
led_blink_mod.v
|
e7254d162d
fpga: Add LED blinker
|
5 лет назад |
|
main.v
|
b8098b9b5a
phy-fpha: Declare miso as inout
|
5 лет назад |
|
parity_func.v
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
profibus_phy_mod.v
|
46bfec6f56
phy-fpga: Set CRC error flag
|
5 лет назад |
|
spi_slave_mod.v
|
4b4d67b430
fpga: re-arrange pins
|
5 лет назад |
|
sync_signal_mod.v
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
tinyfpga_bx.pcf
|
d51bbe5ae2
Add FPGA PHY source code
|
5 лет назад |
|
uart_mod.v
|
fb07d30621
uart: Limit sym timer
|
5 лет назад |
Michael Buesch
b8098b9b5a
phy-fpha: Declare miso as inout