Michael Buesch b8098b9b5a phy-fpha: Declare miso as inout 5 tahun lalu
..
.gitignore d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
Makefile 9280b86c0e phy-fpha: Use PLL 5 tahun lalu
block_ram_mod.v d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
crcgen.py 582596891f crcgen: Move all tests to test module 5 tahun lalu
crcgen_test.py aaeac12a95 crcgen: Run tests in parallel 5 tahun lalu
edge_detect_mod.v d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
led_blink_mod.v e7254d162d fpga: Add LED blinker 5 tahun lalu
main.v b8098b9b5a phy-fpha: Declare miso as inout 5 tahun lalu
parity_func.v d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
profibus_phy_mod.v 46bfec6f56 phy-fpga: Set CRC error flag 5 tahun lalu
spi_slave_mod.v 4b4d67b430 fpga: re-arrange pins 5 tahun lalu
sync_signal_mod.v d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
tinyfpga_bx.pcf d51bbe5ae2 Add FPGA PHY source code 5 tahun lalu
uart_mod.v fb07d30621 uart: Limit sym timer 5 tahun lalu