 Michael Buesch
|
3704f691c9
Fix incorrect MyHDL 'next' use
|
преди 1 година |
|
Michael Buesch
|
b233945422
Remove unnecessary parenthesis
|
преди 1 година |
|
Michael Buesch
|
7043d19067
Use private fields in bit classes
|
преди 1 година |
|
Michael Buesch
|
b4e298793c
Remove old py2 compat oldstyle class
|
преди 1 година |
|
Michael Buesch
|
c4d3eeac29
Update copyright
|
преди 1 година |
|
Michael Buesch
|
9449b48ab1
Remove unnecessary parenthesis
|
преди 1 година |
|
Michael Buesch
|
d5fc1a9dca
Move polynomial parser to utils
|
преди 1 година |
|
Michael Buesch
|
3f6aa6e431
Stricter polynomial parsing
|
преди 1 година |
|
Michael Buesch
|
6ab9b404c2
Fix polynomial coefficient conversion for small bit size
|
преди 1 година |
|
Michael Buesch
|
7e1173cb19
Keep local ref to P
|
преди 1 година |
|
Michael Buesch
|
91fafc4a55
Move test code to own file and don't import in normal runs
|
преди 1 година |
|
Michael Buesch
|
4f2a2f648c
Unify indentation among all supported languages
|
преди 2 години |
|
Michael Buesch
|
b420326d54
Don't generate trailing comma in Verilog module parameter list
|
преди 2 години |
|
Michael Buesch
|
d4496951ff
Rename main module to libcrcgen
|
преди 3 години |
